集成触发器实验报告总结(集成触发器实验结论)
利用触发器设计时序逻辑电路实验内容是什么
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触发器-时序逻辑电路实验报告
专业：
姓名：
学号：
日期：2010.5.19
地点：东三306 B-1
实验报告
课程名称：数字电子技术基础实验 指导老师：樊伟敏 成绩：__________________
实验名称：触发器应用实验 实验类型：设计类 同组学生姓名：__________
第 1 页
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一、实验目的和要求（必填） 二、实验内容和原理（必填）
三、主要仪器设备（必填） 四、操作方法和实验步骤
五、实验数据记录和处理 六、实验结果与分析（必填）
七、讨论、心得
一、实验目的
1. 加深理解各触发器的逻辑功能，
第 2 页
掌握各类触发器功能的转换方法。
2. 熟悉触发器的两种触发方式（电平触发和边沿触发）及其触发特点。
3. 掌握集成J-K触发器和D触发器逻辑功能的测试方法。
4. 学习用J-K触发器和D触发器构成简单的时序电路的方法。
5. 进一步掌握用双踪示波器测量多个波形的方法。
二、主要仪器与设备
第 3 页
实验选用集成电路芯片：74LS00（与非门）、74LS11（与门）、74LS55（与或非门）、74LS74（双D触发器）、74LS107（双J—K 触发器），GOS-6051 型示波器，导线，SDZ-2 实验箱。
三、实验内容和原理
1、D→J-K的转换实验
①设计过程：J-K 触发器和D触发器的次态方程如下：
J-K 触发器：， D触发器：Qn+1=D
第 4 页
若将D 触发器转换为J-K触发器，则有：。
②仿真与实验电路图：仿真电路图如图1所示。操作时时钟接秒信号，便于观察。
图1
③实验结果：
J
K
Qn-1
Qn
功能
保持
1
1
1
置0
1
1
1
1
翻转
1
1
1
置1
1
1
第 5 页
2、D 触发器转换为T’触发器实验
①设计过程：D 触发器和T’触发器的次态方程如下：
D 触发器：Qn+1= D ， T’触发器：Qn+1=!Qn
若将D 触发器转换为T’触发器，则二者的次态方程须相等，因此有：D=!Qn。
②仿真与实验电路图：仿真电路图如图2 所示。操作时时钟接秒信号。
第 6 页
图2
③实验结果：发光二极管按时钟频率闪动，状态来回翻转。
3、J-K→D的转换实验。
①设计过程：J-K 触发器和D触发器的次态方程如下：
J-K 触发器：， D触发器：Qn+1=D
图3
若将J-K触发器转换为D触发器，则二者的次态方程须相等，因此有：
第 7 页
J=D，K=!D。
②仿真与实验电路图：
如图3所示。
③实验结果：符合D触发器的功能，D=1，发光二极管亮，Q=1;D=0,发光二极管不亮，Q=0。
4、J-K→T′的转换实验。
①设计过程：J-K 触发器和T’触发器的次态方程如下：
J-K 触发器：， T’触发器：Qn+1=!Qn
第 8 页
若将J-K 触发器转换为T’触发器，则二者的次态方程须相等，因此有：J=K=1
②仿真与实验电路图：仿真与实验电路图如图4所示。
图4
第 9 页
③实验结果：符合T′触发器的功能，发光二极管按时钟频率闪动，状态来回翻转。
5、用双D触发器设计一个单发脉冲发生器。
（1）手动单次脉冲发生器的测试：手控脉冲接逻辑开关，系列脉冲为秒脉冲信号，两个D 触发器的输出分别接发光二极管。
①实验原理：手动提供一个脉冲，此时第一个D触发器的输出为高电平，经过一个cp脉冲后，由于第二
第 10 页
个D触发器的输入是第一个D触发器的输出，所以其输出也为高电平，Q非为低电平，第一个触发器立刻置零，经过一个cp脉冲的时间，第二个触发器的输出也为低电平，数码管熄灭，亮的时间为一个cp脉冲的时间间隔。
②实验电路：实验电路图如图5 所示。
图5
图6
第 11 页
③实验结果：当手控脉冲输出一个脉冲信号时，单次脉冲发生器的输出端的输出一个秒脉冲信号。
（2）用示波器观察单次脉冲发生器工作状态：手控脉冲和系列脉冲都接1kHz 信号，用示波器观察CP、Q1、Q2 的波形。
①实验电路：实验电路图如图6所示。
②用示波器观察得到的实验波形如图7所示。
第 12 页
(a) CP端与Q1端波形图 (b) Q1端与Q2端波形图
整理上述两幅实拍波形图，绘制出CP、Q1、Q2 的波形如下图所示。
第 13 页
6、用D触发器设计一个4位移位寄存器电路并进行实验（移位寄存器要求能实现串行输入，并行输出与串行输出两种方式。
①设计过程：D触发器的输入为前一个触发器的输出，并且所有触发器使用同一个CP脉冲，串行输入的数据是从第一个D触发器输入。
第 14 页
②仿真与实验电路图：仿真与实验电路图如图7所示。
图7
③实验结果：4位数据实现了移位的并行和串行输出。
7、用J-K触发器设计一个双向时钟脉冲产生电路并进行实验
①设计过程：首先把J-K触发器设计成一个T’触发器，输出的结果和结果的非再与cp脉冲求与，就能实现双向时钟脉冲频率相同，相位不同。
第 15 页
②仿真与实验电路图：仿真与实验电路图如图8所示。
③实验结果：得到的双向时钟脉冲波形如图9。
图8
图9
第 16 页
8、用两片74LS74（4个D触发器）实现四路竞赛抢答器电路。输入为四个按钮S4S3S2S1、总清零端、10kHz时钟脉冲。输出为4路分别连接到LED指示灯。
①设计过程：4个D触发器总清零端接在一起，实现同时清零，并且不受cp脉冲的影响，没有抢答时，取4个D触发器输出的非，四个输出求与，得到的结果与cp脉冲求与，由于四个输出都为1，cp脉冲可以顺利加入四个触发器，当一个人抢答时，输出的非是0，四个输出求与
第 17 页
为0，阻止了cp脉冲的再次加入，此时改变其他D触发器的状态，都不能改变触发器的输出。实验要求cp脉冲的频率要比较高。
②仿真与实验电路图：仿真与实验电路图如图10所示。
图10
③实验结果：实现了抢答器的功能。
第 18 页
四、实验收获
1. 实验前应检查芯片的逻辑功能。接线时按照引脚功能逐步连接，线的颜色最好有所区分便于识别。
2. 该实验中，应注意触发器不用的清零、置数管脚都要接上相应的电平，防止影响触发器的功能。
3. 测试电路功能时，如果用电平指示器（发光二极管）观察，CP脉冲采用0.5s、1s脉冲信号或用逻辑开关，如果用示波器观察，CP脉冲采用1KHz。
第 19 页
4. 由于实验箱上1Hz、1KHz信号驱动能力有限，可在1KHz信号后接非门以增强驱动能力。
第 20 页
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集成计数器实验的心得体会
通过本次实验我了解到计数器种类较多，按构成计数器中的多触发器是否使用一个时钟脉冲源来分，有同步计数器和异步计数器；根据计数制的不同，分为二进制计数器、十进制计数器和任意进制计数器；根据计数的增减趋势，又分为加法、减法和可逆计数器。还有可预置数和可编程序功能计数器等。并且知道了同步计数器的原理和连接方法。
求《触发器及其应用》实验报告 范本 实验目的如下
1.掌握基本RS、JK、D和T触发器的逻辑功能能2.掌握集成触发器的使用方法和逻辑功能的测试方法3.熟悉触发器之间相互转换的方法实验报告1.列表整理各类触发器的逻辑功能2.总结观察得波形，说明触发器的触发方法3.体会触发器的应用
如何利用置零端和复位端给触发器至初态？
基本RS触发器的S和R也分别叫做直接置位端和直接复位端，其逻辑电路如下图所示，为两个与非门组成的RS触发器，它有两个输入端R、S和两个输出端Q、Q非。
而基本RS触发器也是集成触发器中的一种，其中直接置位端和直接复位端的作用包括有：
1、当S'=1，R'=0时：无论触发器原来处于何种状态，由于S=1，则Q=1，Q非=0，触发器处于“1”态（或称置位状态）。
2、当S'=0，R'=1时：无论触发器原来处于何种状态，由于R=1，则Q=0，Q非=1，触发器处于“0”态（或称复位状态）。
3、当S'=0，R'=0时：集成触发器维持原来状态不变。
4、当S'=1，R'=1时：此时无法确定集成触发器的状态。一般这是不允许的，因此触发器的输入端S、R不能同时为1。
扩展资料：
当触发器的两个输入端加入不同逻辑电平时，它的两个输出端Q和Q非有两种互补的稳定状态，一般规定触发器Q端的状态作为触发器的状态。
当Q=1、Q非=0时，称触发器处于1态，反之触发器处于0态。当R=1,S=0时，使触发器置1，或称置位，因置位的决定条件是S=0，故称e799bee5baa6e58685e5aeb931333431373262S端为置1端；当R=0,S=1时，使触发器置0，或称复位。
同理，称R端为置0端或复位端。若触发器原来为1态，欲使之变为0态，必须令R端的电平由1变0，S端的电平由0变1。这里所加的输入信号（低电平）称为触发信号，而由它们导致的转换过程则称为翻转。
JK触发器和D触发器
触发器是具有记忆功能的二进制存储器件，是各种时序逻辑电路的基本器件之一。其结构有同步、主从、维持阻塞等三种电路。触发器按功能可分为RS触发器，JK触发器，D触发器和T触发器等；按电路的触发方式可分为主—从触发器和边沿触发器（包括上升边沿触发器和下降边沿触发器）两大类。目前我国生产的TTL集成触发器主要有边沿D触发器，边沿JK触发器与主—从JK触发器等。利用这些触发器可以转换成其他功能的触发器，但转换成的触发器其触发方式并不改变。例如由边沿变换来的仍是边沿触发方式的触发器。
由两个与非门交叉耦合而成的基本RS触发器是各种触发器的最基本组成部分，能存储一位二进制信息，但存在R+S=1的约束条件，即R端与S端的输入信号不能同时为0。
一个集成触发器通常有三种输入端，第一种是异步置位、复位输入端，用SD、RD表示。如输入端有一个圈，则表示用低电平驱动，当SD或RD端有驱动信号时，触发器的状态不受时钟脉冲与控制输入端所处状态的影响。第二种是时钟输入端，用CP表示，在SD----=RD=1情况下，只有CP脉冲作用时才能使触发器状态更新。如CP输入端没有小圈，表示在CP脉冲上升沿时触发器状态更新，如CP输入端有小圈，则表示在CP脉冲下升沿时触发器状态更新。第三种是控制输入端，用D、J、K等表示。加在控制输入端的信号是触发器状态更新的依据。
触发器的工作原理是什么？
JK触发器是数字电路触发器中的一种电路单元。
JK触发器具有置0、置1、保持和翻转功能，在各类集成触发器中，JK触发器的功能最为齐全。在实际应用中，它不仅有很强的通用性，而且能灵活地转换其他类型的触发器。由JK触发器可以构成D触发器和T触发器。
1.CP=0时，触发器处于一个稳态。CP为0时，G3、G4被封锁，不论J、K为何种状态，Q3、Q4均为1，另一方面,G12、G22也被CP封锁,因而由与或非门组成的触发器处于一个稳定状态，使输出Q、Q状态不变。?
2.CP由0变1时，触发器不翻转，为接收输入信号作准备。?
?JK触发器电路图：
设触发器原状态为Q=0，Q=1。当CP由0变1时，有两个信号通道影响触发器的输出状态，一个是G12和G22打开，直接影响触发器的输出，另一个是G4和G3打开，再经G13和G23影响触发器的状态。前一个通道只经一级与门，而后一个通道则要经一级与非门和一级与门，显然CP的跳变经前者影响输出比经后者要快得多。在CP由0变1时，G22的输出首先由0变1，这时无论G23为何种状态（即无论J、K为何状态），都使Q仍为0。由于Q同时连接G12和G13的输入端，因此它们的输出均为0，使G11的输出Q=1，触发器的状态不变。CP由0变1后，打开G3和G4，为接收输入信号J、K作好准备。?
3.CP?由1变0时触发器翻转?设输入信号J=1、K=0，则Q3=0、Q4=1，G13和G23的输出均为0。当CP?下降沿到来时,G22的输出由1变0,则有Q=1，使G13输出为1，Q=0，触发器翻转。虽然CP变0后，G3、G4、G12和G22封锁，Q3=Q4=1，但由于与非门的延迟时间比与门长（在制造工艺上予以保证）,因此Q3和Q4这一新状态的稳定是在触发器翻转之后。由此可知,该触发器在CP下降沿触发翻转，CP一旦到0电平，则将触发器封锁，处于(1)所分析的情况。?
总之，该触发器在CP下降沿前接受信息，在下降沿触发翻转，在下降沿后触发器被封锁。